Publicación: Diseño e implementación de un procesador de propósito específico sobre una fpga para la inversión de matrices
| dc.contributor.advisor | Fajardo Ariza, Carlos Augusto | |
| dc.contributor.author | Ribero Celis, Camilo Andrés | |
| dc.date.accessioned | 2024-03-03T20:42:20Z | |
| dc.date.available | 2014 | |
| dc.date.available | 2024-03-03T20:42:20Z | |
| dc.date.created | 2014 | |
| dc.date.issued | 2014 | |
| dc.description.abstract | La inversión de matrices es costosa computacionalmente, debido al gran número de operaciones aritméticas que deben realizarse en un algoritmo secuencial, como el algoritmo ejecutado en software. La inversión de matrices aparece con mucha frecuencia en problemas científicos y de ingeniería entre los cuales se pueden citar, las comunicaciones, problemas de optimización, sistemas oscilatorios, circuitos eléctricos, procesamiento de imágenes, mecánica inelástica, problema de Navier Stokes en una cavidad cúbica3. Este trabajo inició buscando como usar FPGAs para la solución de ecuaciones diferenciales con métodos numéricos, como el caso de las Diferencias finitas. Esto condujo a la necesidad de solucionar sistemas de ecuaciones lineales y esto a su vez, a la inversión de matrices. Se utilizó una metodología de diseño de tipo TOP-DOWN estableciendo tres niveles abstracción y posteriormente se usó el lenguaje VHDL para hacer la descripción en hardware del sistema. Este trabajo representa el diseño e implementación de un procesador de propósito específico usado para la inversión de matrices en una FPGA y basado en el algoritmo de Gauss-Jordan con pivoteo parcial. El dispositivo FPGA usado XC3S700AN permitió implementar cinco módulos de procesamiento paralelo en un sistema que puede operar a una frecuencia máxima de 108.69 MHz. En el capítulo 3, se realiza un análisis de desempeño en donde se muestran las expresiones que predicen el comportamiento del sistema, donde , es el número de ciclos de reloj necesarios para completar la inversión de una matriz. Finalmente como trabajo futuro se propone una modificación en la arquitectura que proporciona a GJ-FPGA4 un aumento del desempeño de alrededor del 33%. | |
| dc.description.abstractenglish | The matrix inversion is a highly computationally expensive process, given the large number of arithmetic operations that are required to execute the inversion process. The matrix inversion appears frequently in scientific and engineering problems, including communications, optimization problems, oscillatory systems, electrical circuits, image processing, inelastic mechanics, Navier Stokes problem in a cubic cavity7. This work began with a search for a way to use the FPGA devices to solve differential equations using finite differences. This search led to the need to solve systems of linear equations by the matrix inversion. We present the design and implementation of a special-purpose processor for the matrix inversion in a FPGA and based on the Gauss-Jordan algorithm with partial pivoting. A TOP-DOWN methodology was used, which use three different levels of abstraction: system, algorithm and RTL level. The description of the system at RTL level was done in VHDL. The implementation of the design was done in the XC3S700AN FPGA. We implemented five modules working in parallel. The system can operate at a maximum frequency of 108.69 MHz. The design requires, clock cycles to complete the inversion of a matrix of N files. Finally, as future work, we propose a new architecture GJ-FPGA8, which could increment in the performance in about 33%. 5 | |
| dc.description.degreelevel | Pregrado | |
| dc.description.degreename | Ingeniero Electrónico | |
| dc.format.mimetype | application/pdf | |
| dc.identifier.instname | Universidad Industrial de Santander | |
| dc.identifier.reponame | Universidad Industrial de Santander | |
| dc.identifier.repourl | https://noesis.uis.edu.co | |
| dc.identifier.uri | https://noesis.uis.edu.co/handle/20.500.14071/30559 | |
| dc.language.iso | spa | |
| dc.publisher | Universidad Industrial de Santander | |
| dc.publisher.faculty | Facultad de Ingenierías Fisicomecánicas | |
| dc.publisher.program | Ingeniería Electrónica | |
| dc.publisher.school | Escuela de Ingenierías Eléctrica, Electrónica y Telecomunicaciones | |
| dc.rights | http://creativecommons.org/licenses/by/4.0/ | |
| dc.rights.accessrights | info:eu-repo/semantics/openAccess | |
| dc.rights.creativecommons | Atribución-NoComercial-SinDerivadas 4.0 Internacional (CC BY-NC-ND 4.0) | |
| dc.rights.license | Attribution-NonCommercial 4.0 International (CC BY-NC 4.0) | |
| dc.rights.uri | http://creativecommons.org/licenses/by-nc/4.0 | |
| dc.subject | Fpga | |
| dc.subject | Gauss-Jordan | |
| dc.subject | Inversión De Matrices | |
| dc.subject | Pivoteo Parcial. | |
| dc.subject.keyword | Fpga | |
| dc.subject.keyword | Gauss-Jordan | |
| dc.subject.keyword | Matrix Inversion | |
| dc.subject.keyword | Partial Pivoting. | |
| dc.title | Diseño e implementación de un procesador de propósito específico sobre una fpga para la inversión de matrices | |
| dc.title.english | Design and implementation of a special-purpose processor into an fpga for matrix inversion5. | |
| dc.type.coar | http://purl.org/coar/version/c_b1a7d7d4d402bcce | |
| dc.type.hasversion | http://purl.org/coar/resource_type/c_7a1f | |
| dc.type.local | Tesis/Trabajo de grado - Monografía - Pregrado | |
| dspace.entity.type | Publication |
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