Aceleración de SDR mediante el uso de RFNOC

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dc.contributor.advisorReyes Torres, Óscar Mauricio
dc.contributor.advisorAngulo Julio, Carlos Andrés
dc.contributor.authorOviedo Rueda, Kevin Johan
dc.contributor.authorSantos Rueda, Jorge Andres
dc.date.accessioned2024-03-03T23:57:13Z
dc.date.available2018
dc.date.available2024-03-03T23:57:13Z
dc.date.created2018
dc.date.issued2018
dc.description.abstractLos sistemas de radio definido por software como los USRP serie X300 o E300 contienen un FPGA de altas prestaciones, que de fabrica, se utiliza para el procesa- ´ miento basico de se ´ nales en procesos como ˜ Digital Down Conversion y Digital Up Conversion, los cuales no utilizan la totalidad de los recursos del FPGA. Los recursos restantes podr´ıan aprovecharse para ejecutar algoritmos que normalmente se llevan a cabo en el procesador del servidor, especialmente aquellos que se beneficien de la paralelizacion que los FPGAs ofrecen. En este trabajo se propuso RFNoC ´ como arquitectura integradora que permite el procesamiento heterogeneo en SDR; ´ para sustentar esta propuesta, primero se busco realizar una verificación del entornoútilizando la transformada rapida de Fourier como prueba piloto, documentando laárquitectura y el proceso de implementacion. Después se realizaron pruebas que ´ verificaron el correcto funcionamiento del bloque; estas pruebas consistieron en el analisis de propiedades y medición de exactitud con respecto a su versión teórica. ´ Finalmente se compararon resultados obtenidos del bloque RFNoC con respecto al bloque FFT de GNU-Radio los cuales permitieron indicar las situaciones donde el FPGA o el servidor destacan. Estos resultados ofrecen a los desarrolladores de SDR un metodo para aprovechar el potencial del FPGA en determinados momen- ´ tos y podr´ıa expandir el uso de SDR a nuevas areas de aplicación, cumpliendo la ´ funcion de diversos dispositivos de propósito espec ´ ´ıfico a los que podr´ıa reemplazar.
dc.description.abstractenglishSoftware-defined radio systems such as the USRP series X300 or E300 contain a high-performance FPGA used by default for basic processing of signals in processes such as Digital Down Conversion and Digital Up Conversion, which do not use all the FPGA resources. The remaining resources could be used to execute algorithms that are normally carried out in the server processor, especially those that benefit from the parallelization that FPGAs offer. In this thesis, RFNoC was proposed as an integrating architecture that allows heterogeneous processing in SDR. To support this proposal, first it was sought to verify the environment using the fast Fouier transform as a pilot test, documenting the architecture features and the implementation process. After that, tests were carried out to verify the correct behavior of the block. It were consisted of properties analysis and accuracy measurement with respect to its theoretical version. Finally, results obtained from the RFNoC block were compared with respect to the GNU-Radio FFT block, which allowed to indicate where the FPGA or the server procesor stand out. These results offer SDR developers a method to harness the potential of the FPGA at certain times and could expand the use of SDR to new application areas, fulfilling the function of various specific purpose devices that it could replace.
dc.description.degreelevelPregrado
dc.description.degreenameIngeniero Electrónico
dc.format.mimetypeapplication/pdf
dc.identifier.instnameUniversidad Industrial de Santander
dc.identifier.reponameUniversidad Industrial de Santander
dc.identifier.repourlhttps://noesis.uis.edu.co
dc.identifier.urihttps://noesis.uis.edu.co/handle/20.500.14071/37834
dc.language.isospa
dc.publisherUniversidad Industrial de Santander
dc.publisher.facultyFacultad de Ingenierías Fisicomecánicas
dc.publisher.programIngeniería Electrónica
dc.publisher.schoolEscuela de Ingenierías Eléctrica, Electrónica y Telecomunicaciones
dc.rightshttp://creativecommons.org/licenses/by/4.0/
dc.rights.accessrightsinfo:eu-repo/semantics/openAccess
dc.rights.creativecommonsAtribución-NoComercial-SinDerivadas 4.0 Internacional (CC BY-NC-ND 4.0)
dc.rights.licenseAttribution-NonCommercial 4.0 International (CC BY-NC 4.0)
dc.rights.urihttp://creativecommons.org/licenses/by-nc/4.0
dc.subjectAceleracion De Software
dc.subjectFft
dc.subjectFpga
dc.subjectGnu-Radio
dc.subjectHdl
dc.subjectRf- ´ Noc
dc.subjectSoftware Defined Radio
dc.subjectUsrp
dc.subject.keywordFft
dc.subject.keywordFpga
dc.subject.keywordGnu-Radio
dc.subject.keywordHdl
dc.subject.keywordRfnoc
dc.subject.keywordSoftware-Acceleration
dc.subject.keywordSoftware Defined Radio
dc.subject.keywordUsrp.
dc.titleAceleración de SDR mediante el uso de RFNOC
dc.title.englishSdr acceleration by using rfnoc
dc.type.coarhttp://purl.org/coar/version/c_b1a7d7d4d402bcce
dc.type.hasversionhttp://purl.org/coar/resource_type/c_7a1f
dc.type.localTesis/Trabajo de grado - Monografía - Pregrado
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Ingeniería Electrónica