A verified risc-v im based processor with an external debugging capability

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dc.contributor.advisorRoa Fuentes, Elkim Felipe
dc.contributor.authorMorales Norato, Hanssel Enrique
dc.date.accessioned2024-03-04T01:11:53Z
dc.date.available2021
dc.date.available2024-03-04T01:11:53Z
dc.date.created2021
dc.date.issued2021
dc.description.abstractAlcanzar un bajo consumo de energía es uno de los desafíos críticos, en los nodos de sensoresde Internet de las cosas (loT) que funcionan con baterías de bajo costo. Estos nodos suelen estarcoordinados por un procesador que recopila, opera y transmite datos desde múltiples sensores ala nube. Los procesadores de loT deben administrar cargas de trabajo caracterizadas por ráfagasintermitentes de operaciones de procesamiento intensivo mezcladas con períodos prolongados debaja actividad. La minimización de la potencia dinámica a través de microarquitecturas de baja conmutación ha sido el foco de soluciones recientes. Aunque esto puede conducir a una baja eficienciade ejecución aumentando el tiempo de ejecución por lo tanto, conduciendo a un alto aumento de laenergia consumida. Este trabajo explora la adición de técnicas de aceleración de bajo costo paramejorar la eficiencia computacional en el diseño de Arcabuco, un procesador en orden de un soloproblema basado en RISC-V | / IM. Lo que logra 2.7 CoreMark/MHz y 1.13 DMIPS/MHz, con unconsumo de energía de 84.46/¿.W/MHz. Proporcionando una solución alternativa a las aplicaciones de bajo consumo de energía.
dc.description.abstractenglishReaching low-energy consumption is one of the critical challenges in low-cost, and battery-poweredinternet of things (loT) sensor nodes. These nodes are usually coordinated by a processor which collects, operates, and transmits data from multiple sensors to the cloud. loT processors must manageworkloads characterized by intermittent bursts of compute-intensive operations mixed with prolonged periods of low activity. Dynamic power minimization through low switching microarchitectureshas been the focus of recent solutions. Though this can lead to low execution efficiency increasingthe execution time, and therefore, leading to high energy loss. This work explores the addition of softacceleration techniques to enhance the computing efficiency in the design of Arcabuco, a RISC-V I/IMbased single-issue in-order processor. Which achieves 2.7 CoreMark/MHz and 1.13 DMIPS/MHz,with a power consumption of 84.46,W/MHz. Providing an alternative solution to low-energy limita- tions.
dc.description.degreelevelPregrado
dc.description.degreenameIngeniero Electrónico
dc.format.mimetypeapplication/pdf
dc.identifier.instnameUniversidad Industrial de Santander
dc.identifier.reponameUniversidad Industrial de Santander
dc.identifier.repourlhttps://noesis.uis.edu.co
dc.identifier.urihttps://noesis.uis.edu.co/handle/20.500.14071/40975
dc.language.isospa
dc.publisherUniversidad Industrial de Santander
dc.publisher.facultyFacultad de Ingenierías Fisicomecánicas
dc.publisher.programIngeniería Electrónica
dc.publisher.schoolEscuela de Ingenierías Eléctrica, Electrónica y Telecomunicaciones
dc.rightshttp://creativecommons.org/licenses/by/4.0/
dc.rights.accessrightsinfo:eu-repo/semantics/openAccess
dc.rights.creativecommonsAtribución-NoComercial-SinDerivadas 4.0 Internacional (CC BY-NC-ND 4.0)
dc.rights.licenseAttribution-NonCommercial 4.0 International (CC BY-NC 4.0)
dc.rights.urihttp://creativecommons.org/licenses/by-nc/4.0
dc.subjectRisc-V
dc.subjectArquitectura De Computadores
dc.subjectMicroelectrónica
dc.subjectCircuitos Digitales.
dc.subject.keywordRisc-V
dc.subject.keywordComputer Architecture
dc.subject.keywordMicroelectronics
dc.subject.keywordDigital Circuits.
dc.titleA verified risc-v im based processor with an external debugging capability
dc.title.englishA verified risc-v | based processor with an external debugging capabiity [j
dc.type.coarhttp://purl.org/coar/version/c_b1a7d7d4d402bcce
dc.type.hasversionhttp://purl.org/coar/resource_type/c_7a1f
dc.type.localTesis/Trabajo de grado - Monografía - Pregrado
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Ingeniería Electrónica